AMD EPYC 8224PN 基準、測試和規格
AMD EPYC 8224PN 有 24 個內核和 48 個線程，並且基於 4。 AMD EPYC 系列的基因。 處理器使用帶有 SP6 套接字的主板，並在 Q3/2023 發布。
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| 姓: | AMD EPYC 8224PN |
| 家庭: | AMD EPYC |
| CPU組: | AMD EPYC 8004/9004 |
| 部分: | Desktop / Server |
| 一代: | 4 |
| 前任: | -- |
| 接班人: | -- |
CPU 沿襲
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| CPU 核心 / Threads: | 24 / 48 |
| 核心架構: | normal |
| 核心: | 24x Zen 4c |
CPU核心數與基礎頻率| 超執行緒技術: | 是 |
| 超頻: | 否 |
| 頻率: | 2.00 GHz |
| 加速頻率 頻率 (1 核心): | 3.00 GHz |
| 加速頻率 頻率 (24 核心): | 2.90 GHz |
内建顯示晶片
硬體解碼支援
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| 記憶體類型: | 內存帶寬: |
|---|---|
| DDR5-4800 | 230.4 GB/s |
| 最大記憶體: | |
| 記憶體通道: | 6 |
| ECC: | 是 |
| PCIe: | 5.0 x 96 |
| AES-NI: | 是 |
記憶體 & PCIe
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| TDP (PL1): | 120 W |
| TDP (PL2): | -- |
| TDP up: | -- |
| TDP down: | -- |
| Tjunction max.: | -- |
散熱管理
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| 指令集 (ISA): | x86-64 (64 bit) |
| ISA擴展: | SSE4.2, AVX2, AVX-512, BFLOAT16, VNNI |
| L2-Cache: | -- |
| L3-Cache: | 64.00 MB |
| 架構: | Bergamo/Siena (Zen 4c) |
技術細節| 製程: | 5 nm |
| 虛擬化: | AMD-V, SVM |
| 針腳: | SP6 |
| 發售日期: | Q3/2023 |
| 代號: | -- |
24C 48T @ 2.00 GHz (3.00 GHz)
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基準測試結果
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